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      標(biāo)簽　>　ic設(shè)計(jì)

      ic設(shè)計(jì)

      ic設(shè)計(jì)

      +關(guān)注37人關(guān)注

      IC設(shè)計(jì)，Integrated Circuit Design，或稱為集成電路設(shè)計(jì)，是電子工程學(xué)和計(jì)算機(jī)工程學(xué)的一個(gè)學(xué)科，其主要內(nèi)容是運(yùn)用專業(yè)的邏輯和電路設(shè)計(jì)技術(shù)設(shè)計(jì)集成電路。

      文章：1297個(gè) 瀏覽：107720次 帖子：85個(gè)

      ic設(shè)計(jì)技術(shù)

      邏輯綜合在整個(gè)IC設(shè)計(jì)流程RTL2GDS中的位置

      根據(jù)摩爾定律的發(fā)展，晶體管的Poly的最小柵極長度已經(jīng)到達(dá)了1nm甚至更小，集成電路的規(guī)模越 來越大，集成度越來越高。

      2023-03-27 標(biāo)簽：IC設(shè)計(jì)EDA工具HDL 2.9k 0

      淺談IC驗(yàn)證者眼中的FS

      淺談IC驗(yàn)證者眼中的FS

      明確需求，形成OR文檔是芯片研發(fā)諸多環(huán)節(jié)中，比較重要的一步，但只是第一步。

      2023-06-02 標(biāo)簽：IC設(shè)計(jì)AMBASPEC 2.9k 0

      模擬IC設(shè)計(jì)的這些坑你都踩過嗎？

      模擬IC是負(fù)責(zé)生產(chǎn)、放大和處理各類模擬信號的電路，工程師通過模擬電路把模擬信號放大縮小后，再全部記錄下來，是連續(xù)的信號；而數(shù)字IC則是通過0和1兩個(gè)代號...

      2023-03-06 標(biāo)簽：模擬ICIC設(shè)計(jì)EDA工具 2.9k 0

      芯片設(shè)計(jì)及使用的EDA工具介紹

      芯片設(shè)計(jì)及使用的EDA工具介紹

      機(jī)遇總是與挑戰(zhàn)并存，目前國內(nèi)在高端EDA工具研發(fā)方面，面臨著如Synopsys、Cadence和Mentor等國際EDA供應(yīng)商的巨大挑戰(zhàn)，即使是作為本土...

      2024-01-18 標(biāo)簽：集成電路IC設(shè)計(jì)eda 2.9k 0

      工程師解說：一顆芯片出爐的成本法則

      作為電子產(chǎn)業(yè)鏈上的一員，無論是芯片的設(shè)計(jì)者，生產(chǎn)者，測試者，使用者都很想了解清楚一顆芯片的成本究竟由哪幾個(gè)部分構(gòu)成。這里我來就我的理解簡要說明一下。

      2016-02-16 標(biāo)簽：半導(dǎo)體產(chǎn)業(yè)IC設(shè)計(jì)半導(dǎo)體芯片 2.9k 0

      Verdi使用技巧(一)

      Verdi使用技巧(一)

      如果問廣大的ICer一個(gè)問題，大家在日常仿真中用的最頻繁的工具是什么?

      2023-04-25 標(biāo)簽：IC設(shè)計(jì)soc仿真 2.9k 0

      IC設(shè)計(jì)：Verilog是如何實(shí)現(xiàn)RR輪詢調(diào)度的？

      在設(shè)計(jì)中，我們經(jīng)常會(huì)用到RR（Round-Robin,RR）輪詢調(diào)度，用于保證在一個(gè)時(shí)間段內(nèi)的多個(gè)請求信號都能得到公平響應(yīng)。

      2023-12-13 標(biāo)簽：寄存器IC設(shè)計(jì)Verilog 2.8k 0

      2016年電子半導(dǎo)體行業(yè)年度收購大盤點(diǎn)TOP20

      為了搶占市場、擴(kuò)大自身影響力，乃至提高國際地位，各大企業(yè)巨頭大大小小的收購事件頻傳。管中窺豹可見一斑，從這些收購事件中不僅可以看出各大企業(yè)的戰(zhàn)略規(guī)劃，也...

      2017-01-06 標(biāo)簽：IC設(shè)計(jì)半導(dǎo)體芯片2016年度回顧 2.8k 0

      數(shù)字IC前端設(shè)計(jì)流程及工具

      數(shù)字IC前端設(shè)計(jì)流程及工具

      以門級網(wǎng)表（Netlist）生成為分界線，之前稱為前端，之后稱為后端。

      2023-06-25 標(biāo)簽：IC設(shè)計(jì)RTLDFT 2.8k 0

      華大九天物理驗(yàn)證EDA工具Empyrean Argus助力芯片設(shè)計(jì)

      華大九天物理驗(yàn)證EDA工具Empyrean Argus助力芯片設(shè)計(jì)

      在芯片設(shè)計(jì)的流片之路充滿挑戰(zhàn)，物理驗(yàn)證EDA工具無疑是這“最后一公里”關(guān)鍵且不可或缺的利器。它通過設(shè)計(jì)規(guī)則檢查、版圖與原理圖一致性驗(yàn)證等關(guān)鍵流程，為IC...

      2025-07-03 標(biāo)簽：IC設(shè)計(jì)芯片設(shè)計(jì)eda 2.8k 0

      ic設(shè)計(jì)和fpga設(shè)計(jì)有什么不同 ic設(shè)計(jì)和ic驗(yàn)證哪個(gè)好

      IC設(shè)計(jì)主要是實(shí)現(xiàn)特定的電路功能，并且產(chǎn)生的是固定的芯片結(jié)構(gòu)，不可重編程。而FPGA設(shè)計(jì)的核心功能是支持邏輯電路、時(shí)序電路等硬件電路的可編程實(shí)現(xiàn)，可通過...

      2023-04-26 標(biāo)簽：fpgaIC設(shè)計(jì)eda 2.8k 0

      改善要求苛刻的EDA計(jì)算任務(wù) 是否在優(yōu)化云計(jì)算優(yōu)勢以加快可靠性驗(yàn)證？

      改善要求苛刻的EDA計(jì)算任務(wù) 是否在優(yōu)化云計(jì)算優(yōu)勢以加快可靠性驗(yàn)證？

      設(shè)計(jì)的復(fù)雜性和上市時(shí)間的壓力迫使公司尋找利用可用資源的創(chuàng)新方法。云計(jì)算提供了一個(gè)可擴(kuò)展且可持續(xù)的平臺(tái)，可以顯著改善要求苛刻的 EDA 計(jì)算任務(wù)（如 Ca...

      2021-10-11 標(biāo)簽：IC設(shè)計(jì)云計(jì)算soc 2.8k 0

      2016年EDA/IC設(shè)計(jì)頻道應(yīng)用文章精選

      2016 年EDA IC設(shè)計(jì)技術(shù)都有哪些最新熱點(diǎn)，PCB設(shè)計(jì)布線策略、走線技巧有哪些，PCB Layout及電路設(shè)計(jì)規(guī)范是怎樣的，PCB設(shè)計(jì)抗靜電方法設(shè)...

      2017-01-26 標(biāo)簽：ic設(shè)計(jì)eda電子設(shè)計(jì)自動(dòng)化 2.8k 0

      數(shù)字IC設(shè)計(jì)流程中為什么要做門級仿真？

      數(shù)字IC設(shè)計(jì)流程中為什么要做門級仿真？

      門級仿真（gate levelsimulation）也稱之為后仿真，是數(shù)字IC設(shè)計(jì)流程中的一個(gè)重要步驟。

      2023-06-07 標(biāo)簽：IC設(shè)計(jì)芯片設(shè)計(jì)仿真 2.7k 0

      封裝類型的選擇

      封裝類型的選擇是IC 設(shè)計(jì)和封裝測試的一個(gè)重要環(huán)節(jié)。如果封裝類型選擇不當(dāng)，可能會(huì)造成產(chǎn)品功能無法實(shí)現(xiàn)，或者成本過高，甚至導(dǎo)致整個(gè)設(shè)計(jì)失敗。

      2023-04-03 標(biāo)簽：pcbIC設(shè)計(jì)封裝 2.7k 0

      數(shù)字IC設(shè)計(jì)中為什么要避免鎖存器呢？

      數(shù)字IC設(shè)計(jì)中為什么要避免鎖存器呢？

      上學(xué)時(shí)，老師說判斷語句要把條件寫全， **不然會(huì)生成鎖存器，做項(xiàng)目時(shí)又說多比特寄存器信號的賦值一定要加if條件，不讓出現(xiàn)else的賦值** 。就很矛盾，...

      2023-11-09 標(biāo)簽：fpgaIC設(shè)計(jì)鎖存器 2.7k 0

      硬件設(shè)計(jì)案例分析之原理圖設(shè)計(jì)規(guī)范（二）

      硬件設(shè)計(jì)案例分析之原理圖設(shè)計(jì)規(guī)范（二）

      在原理圖中，對于多個(gè)單元運(yùn)放IC和邏輯電路IC一般要按照電路功能將每個(gè)單元分開放置，便于對電路的理解和視圖，也符合電路功能單元集中布局的規(guī)則。

      2023-04-23 標(biāo)簽：邏輯電路IC設(shè)計(jì)PCB布線 2.7k 0

      IC設(shè)計(jì)：ram的折疊設(shè)計(jì)操作步驟

      IC設(shè)計(jì)：ram的折疊設(shè)計(jì)操作步驟

      在IC設(shè)計(jì)中，我們有時(shí)會(huì)使用深度很大，位寬很小的ram。例如深度為1024，位寬為4bit的ram。

      2024-03-04 標(biāo)簽：IC設(shè)計(jì)RAM 2.6k 0

      IC驗(yàn)證的主要工作流程和驗(yàn)證工具是什么？

      驗(yàn)證其實(shí)是一個(gè)“證偽”的過程，從流程到工具，驗(yàn)證工程師的終極目的都只有一個(gè)。

      2023-05-31 標(biāo)簽：芯片IC設(shè)計(jì)eda 2.6k 0

      國產(chǎn)EDA如何？EDA設(shè)計(jì)的重要性

      國產(chǎn)EDA如何？EDA設(shè)計(jì)的重要性

      EDA，是指電子設(shè)計(jì)自勱化（ Electronic Design Automation）用于芯片設(shè)計(jì)時(shí)的重要工具，設(shè)計(jì)時(shí)工程師會(huì)用程式碼規(guī)劃芯片功能，再...

      2024-02-27 標(biāo)簽：邏輯電路IC設(shè)計(jì)芯片設(shè)計(jì) 2.6k 0

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