亚洲精品久久久久久久久久久,亚洲国产精品一区二区制服,亚洲精品午夜精品,国产成人精品综合在线观看,最近2019中文字幕一页二页

0
  • 聊天消息
  • 系統(tǒng)消息
  • 評論與回復(fù)
登錄后你可以
  • 下載海量資料
  • 學(xué)習(xí)在線課程
  • 觀看技術(shù)視頻
  • 寫文章/發(fā)帖/加入社區(qū)
會(huì)員中心
創(chuàng)作中心

完善資料讓更多小伙伴認(rèn)識(shí)你,還能領(lǐng)取20積分哦,立即完善>

3天內(nèi)不再提示

關(guān)于AXI4-Stream協(xié)議總結(jié)分享

FPGA之家 ? 來源:FPGA之家 ? 作者:FPGA之家 ? 2022-06-23 10:08 ? 次閱讀
加入交流群
微信小助手二維碼

掃碼添加小助手

加入工程師交流群


AXI4-Stream去掉了地址項(xiàng),允許無限制的數(shù)據(jù)突發(fā)傳輸規(guī)模;

fc6639f6-f290-11ec-ba43-dac502259ad0.png

二、握手機(jī)

只有當(dāng)VALID和READY同時(shí)為高時(shí),才能進(jìn)行傳輸。

VALID和READY信號(hào)的先后順序有一下三種形式:

fc785b22-f290-11ec-ba43-dac502259ad0.jpg

2.1VALID早于READY信號(hào)

fc81211c-f290-11ec-ba43-dac502259ad0.jpg

2.2READY信號(hào)早于VALID信號(hào)

fc8aa034-f290-11ec-ba43-dac502259ad0.jpg

2.3 VALID信號(hào)與READY信號(hào)同時(shí)

三、基本事務(wù)

AXI4-Stream跟AXI4的區(qū)別就是AXI4-Stream去除了地址線,這樣就不涉及讀寫數(shù)據(jù)的概念了,只有簡單的發(fā)送與接收說法,減少了延時(shí)。由于AXI4-Stream協(xié)議(amba4_axi4_stream_v1_0_protocol_spec.pdf)沒有時(shí)序圖,因此,我使用XILINX公司的產(chǎn)品指導(dǎo)手冊(pg007_srio_gen2_v3_1.pdf)里的一個(gè)時(shí)序圖來演示AXI4-Stream各個(gè)信號(hào)的關(guān)系。如下圖所示:

fc970ec8-f290-11ec-ba43-dac502259ad0.jpg

上圖中,tready信號(hào)一直處于高電平,表示從設(shè)備做好了接收數(shù)據(jù)準(zhǔn)備。tvalid變?yōu)楦唠娖降耐瑫r(shí),tdata、tkeep、tuser也同時(shí)進(jìn)行發(fā)送。在tdata最后一個(gè)字節(jié)數(shù)據(jù)時(shí),tlast發(fā)送一個(gè)高電平脈沖。數(shù)據(jù)發(fā)送完成后,tvalid變?yōu)榈碗娖健_@樣一次傳輸就完成了。

審核編輯 :李倩

聲明:本文內(nèi)容及配圖由入駐作者撰寫或者入駐合作網(wǎng)站授權(quán)轉(zhuǎn)載。文章觀點(diǎn)僅代表作者本人,不代表電子發(fā)燒友網(wǎng)立場。文章及其配圖僅供工程師學(xué)習(xí)之用,如有內(nèi)容侵權(quán)或者其他違規(guī)問題,請聯(lián)系本站處理。 舉報(bào)投訴
  • 信號(hào)
    +關(guān)注

    關(guān)注

    11

    文章

    2877

    瀏覽量

    79533
  • Stream
    +關(guān)注

    關(guān)注

    0

    文章

    21

    瀏覽量

    8209

原文標(biāo)題:AXI4-Stream協(xié)議總結(jié)

文章出處:【微信號(hào):zhuyandz,微信公眾號(hào):FPGA之家】歡迎添加關(guān)注!文章轉(zhuǎn)載請注明出處。

收藏 人收藏
加入交流群
微信小助手二維碼

掃碼添加小助手

加入工程師交流群

    評論

    相關(guān)推薦
    熱點(diǎn)推薦

    AXI GPIO擴(kuò)展e203 IO口簡介

    Register)來設(shè)置GPIO引腳的中斷觸發(fā)模式,例如上升沿觸發(fā)或下降沿觸發(fā)。 4.AXI接口支持:AXI-GPIO支持AXI總線協(xié)議,可以與其他
    發(fā)表于 10-22 08:14

    關(guān)于AXI Lite無法正常握手的問題

    關(guān)于AXI Lite的問題 為什么我寫的AXI Lite在使用AXI Lite Slave IP的時(shí)候可以正常握手,但是在使用AXI Lit
    發(fā)表于 07-16 18:50

    相關(guān)協(xié)議信號(hào)總結(jié)

    電子發(fā)燒友網(wǎng)站提供《相關(guān)協(xié)議信號(hào)總結(jié).xlsx》資料免費(fèi)下載
    發(fā)表于 06-25 15:34 ?5次下載

    RDMA簡介8之AXI分析

    AXI4 總線是第四代 AXI 總線,其定義了三種總線接口,分別為:AXI4AXI4-Lite 和 AXI4-Stream接口。其中
    的頭像 發(fā)表于 06-24 23:22 ?403次閱讀
    RDMA簡介8之<b class='flag-5'>AXI</b>分析

    RDMA簡介9之AXI 總線協(xié)議分析2

    ? 這里以功能完備的 AXI4 接口舉例說明 AXI4 總線的相關(guān)特點(diǎn)。AXI4 總線采用讀寫通道分離且數(shù)據(jù)通道與控制通道分離的方式,這樣的總線通道使其具有多主多從的連接特性和并行處理的能力,能夠
    發(fā)表于 06-24 18:02

    RDMA簡介8之AXI 總線協(xié)議分析1

    ,分別為:AXI4、AXI4-Lite 和 AXI4-Stream接口。其中 AXI4 也稱為 AXI4-Full 是一種基于地址的高性能傳
    發(fā)表于 06-24 18:00

    NVMe IP之AXI4總線分析

    傳輸和亂序傳輸?shù)?,并且?shù)據(jù)位寬也受到限制。由于不需要支持大多數(shù)高性能功能,AXI4-Lite所需的資源也較少。 AXI4-Stream:主要用于高速數(shù)據(jù)流數(shù)據(jù)傳輸。相比于其他總線協(xié)議
    發(fā)表于 06-02 23:05

    NVMe簡介之AXI總線

    NVMe需要用AXI總線進(jìn)行高速傳輸。而AXI總線是ARM公司提出的AMBA(Advanced Microcontroller Bus Architecture)協(xié)議中的重要組成部分,主要面向高性能、高帶寬、低延時(shí)的片內(nèi)互連需求
    的頭像 發(fā)表于 05-21 09:29 ?511次閱讀
    NVMe簡介之<b class='flag-5'>AXI</b>總線

    NVMe協(xié)議簡介之AXI總線

    向高速數(shù)據(jù)流傳輸?shù)?b class='flag-5'>AXI4-Stream接口。如表1所示展示了三種類型接口的主要特點(diǎn)對比。 表1 三種類型AXI4接口對比 AXI4總線具有讀寫地址、數(shù)據(jù)通道分離的特性,使控制通道與數(shù)據(jù)通道分離、讀通道
    發(fā)表于 05-17 10:27

    AXI協(xié)議規(guī)范總結(jié)

    寫數(shù)據(jù)通道從主設(shè)備傳輸數(shù)據(jù)到從設(shè)備,在寫傳輸時(shí),從設(shè)備使用寫響應(yīng)通道通知主設(shè)備傳輸完成。
    的頭像 發(fā)表于 05-12 09:44 ?2741次閱讀
    <b class='flag-5'>AXI</b><b class='flag-5'>協(xié)議</b>規(guī)范<b class='flag-5'>總結(jié)</b>

    高速SSD存儲(chǔ)系統(tǒng)中數(shù)據(jù)緩存控制器整體頂層設(shè)計(jì)

    數(shù)據(jù)緩存控制器主要實(shí)現(xiàn)了對大量突發(fā)數(shù)據(jù)的緩存、AXI4接口與AXI4-Stream接口之間的轉(zhuǎn)換和NVMe命令的生成等功能。這里主要介紹相關(guān)開發(fā)流程。
    的頭像 發(fā)表于 04-14 10:46 ?547次閱讀
    高速SSD存儲(chǔ)系統(tǒng)中數(shù)據(jù)緩存控制器整體頂層設(shè)計(jì)

    一文詳解AXI DMA技術(shù)

    AXI直接數(shù)值存?。―rect Memory Access,DMA)IP核在AXI4內(nèi)存映射和AXI4流IP接口之間提供高帶寬的直接內(nèi)存訪問。DMA可以選擇分散收集(Scatter Gather
    的頭像 發(fā)表于 04-03 09:32 ?1958次閱讀
    一文詳解<b class='flag-5'>AXI</b> DMA技術(shù)

    一文詳解Video In to AXI4-Stream IP核

    Video In to AXI4-Stream IP核用于將視頻源(帶有同步信號(hào)的時(shí)鐘并行視頻數(shù)據(jù),即同步sync或消隱blank信號(hào)或者而后者皆有)轉(zhuǎn)換成AXI4-Stream接口形式,實(shí)現(xiàn)了接口轉(zhuǎn)換。該IP還可使用VTC核,VTC在視頻輸入和視頻處理之間起橋梁作用。
    的頭像 發(fā)表于 04-03 09:28 ?2056次閱讀
    一文詳解Video In to <b class='flag-5'>AXI4-Stream</b> IP核

    AXI接口FIFO簡介

    AXI接口FIFO是從Native接口FIFO派生而來的。AXI內(nèi)存映射接口提供了三種樣式:AXI4、AXI3和AXI4-Lite。除了Na
    的頭像 發(fā)表于 03-17 10:31 ?1625次閱讀
    <b class='flag-5'>AXI</b>接口FIFO簡介

    國產(chǎn)FPGA SOC 雙目視覺處理系統(tǒng)開發(fā)實(shí)例

    AXI4-Stream總線構(gòu)建的高速數(shù)據(jù)通道(峰值帶寬可達(dá)12.8GB/s),實(shí)現(xiàn)ARM與FPGA間的納秒級(ns)延遲交互,較傳統(tǒng)方案提升了3倍的傳輸效率,極大地提升了系統(tǒng)整體
    的頭像 發(fā)表于 02-20 08:05 ?1921次閱讀
    國產(chǎn)FPGA SOC 雙目視覺處理系統(tǒng)開發(fā)實(shí)例