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Versal 產(chǎn)品組合基于臺(tái)積電（TSMC）的 7 nm FinFET 工藝技術(shù)，是第一個(gè)將軟件可編程性與特定領(lǐng)域硬件加速和靈活應(yīng)變能力相結(jié)合的平臺(tái)，這對(duì)于跟上當(dāng)今快速的創(chuàng)新步伐至關(guān)重要。

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versal技術(shù)

如何利用XPIO構(gòu)建并實(shí)現(xiàn)帶有Strobe的高速接口設(shè)計(jì)

在 AMD Versal 自適應(yīng) SoC 器件中，SelectIO 是實(shí)現(xiàn)高速接口的重要組成部分。它為器件提供了靈活且高性能的通用 I/O 資源，支持多...

2025-10-17 標(biāo)簽：amd soc 高速接口 1.6k 0

AMD Versal自適應(yīng)SoC內(nèi)置自校準(zhǔn)的工作原理

本文提供有關(guān) AMD Versal 自適應(yīng) SoC 內(nèi)置自校準(zhǔn) (BISC) 工作方式的詳細(xì)信息。此外還詳述了 Versal 的異步模式及其對(duì) BISC...

2025-10-21 標(biāo)簽：amd 存儲(chǔ)器接口 3.6k 0

AMD Versal自適應(yīng)SoC上的級(jí)聯(lián)模式示例

本篇博文主要講解在 PL 中如何使用 AXI Interrupt Controller (INTC) 的級(jí)聯(lián)模式，將 IP 核超過(guò) 32 個(gè)的中斷連接到...

2025-07-22 標(biāo)簽：amd soc 中斷 1.3k 0

Versal 600G DCMAC Subsystem LogiCORE IP產(chǎn)品指南

AMD 自適應(yīng)計(jì)算文檔按一組標(biāo)準(zhǔn)設(shè)計(jì)進(jìn)程進(jìn)行組織，以便幫助您查找當(dāng)前開(kāi)發(fā)任務(wù)相關(guān)的內(nèi)容。您可以在設(shè)計(jì)中心頁(yè)面上訪問(wèn) AMD Versal 自適應(yīng) SoC...

2025-06-03 標(biāo)簽：amd 內(nèi)核 soc 457 0

AMD Versal自適應(yīng)SoC器件Advanced Flow概覽（下）

在 AMD Vivado Design Suite 2024.2 版本中，Advanced Flow 自動(dòng)為所有 AMD Versal 自適應(yīng) SoC ...

2025-01-23 標(biāo)簽：amd soc 命令 1.2k 0

AMD Versal自適應(yīng)SoC器件Advanced Flow概覽（上）

在最新發(fā)布的 AMD Vivado Design Suite 2024.2 中，引入的新特性之一是啟用了僅適用于 AMD Versal 自適應(yīng) SoC ...

2025-01-17 標(biāo)簽：amd soc 可編程邏輯 1.1k 0

AMD Versal自適應(yīng)SoC DDRMC如何使用Micron仿真模型進(jìn)行仿真

AMD Versal 自適應(yīng) SoC 器件上 DDR4 硬核控制器 DDRMC 跑仿真時(shí)，按照 IP 的默認(rèn)設(shè)置，在 IP wizard 中使能了“In...

2025-01-10 標(biāo)簽：amd 控制器 soc 1.3k 0

AMD 通過(guò)第二代 Versal 器件為 AI 驅(qū)動(dòng)型嵌入式系統(tǒng)提供單芯片智能

隨著嵌入式 AI、視頻和控制應(yīng)用的爆炸式增長(zhǎng)，對(duì)異構(gòu)處理的需求越來(lái)越大，以便在狹小的區(qū)域和功率限制內(nèi)加速端到端計(jì)算。多芯片處理解決方案具有巨大的功耗、面...

2024-11-29 標(biāo)簽：amd 嵌入式系統(tǒng)單芯片 1.4k 0

AMD Versal自適應(yīng)SoC GTM如何用XSIM仿真和觀察PAM4信號(hào)

PAM4(4-Level Pulse Amplitude Modulation) 的全稱是四電平脈沖幅度調(diào)制，通過(guò)種不同的電平進(jìn)行信號(hào)傳輸，每個(gè)電平幅度...

2024-11-22 標(biāo)簽：amd 仿真信號(hào) 1.4k 0

【ALINX 技術(shù)分享】AMD Versal AI Edge 自適應(yīng)計(jì)算加速平臺(tái)之 Versal 介紹（2）

【ALINX 技術(shù)分享】AMD Versal AI Edge 自適應(yīng)計(jì)算加速平臺(tái)之 Versal 介紹，以及Versal 芯片開(kāi)發(fā)流程的簡(jiǎn)介。

2024-03-07 標(biāo)簽：處理器 FPGA Xilinx 2.3k 0

AMD Versal系列CIPS IP核建立示例工程

接著上一篇“AMD Versal系列CIPS IP核介紹”文章來(lái)進(jìn)一步講解如何來(lái)建立CIPS IP核示例工程。

2023-12-05 標(biāo)簽：amd 調(diào)試 IP核 1.3k 0

Versal GTM如何用Tcl命令在IBERT生成QPRBS13序列

目前對(duì)于 Vivado 2023.1 版本的 IBERT GUI 界面暫時(shí)不支持 QPRBS13 的設(shè)置，需要通過(guò) tcl 或者端口設(shè)置的方法來(lái)實(shí)現(xiàn)。

2023-08-18 標(biāo)簽：amd 仿真命令 2.4k 0

AMD Versal系列FPGA NoC介紹及實(shí)戰(zhàn)

NoC是相對(duì)于SoC的新一代片上互連技術(shù)，從計(jì)算機(jī)發(fā)展的歷史可以看到NoC 必將是SoC 之后的下一代主流技術(shù)，SoC 通常指在單一芯片上實(shí)現(xiàn)的數(shù)字計(jì)算...

2023-07-13 標(biāo)簽：fpga amd 計(jì)算機(jī) 2k 0

Versal HDIO OBUFT和IOBUF三態(tài)時(shí)序影響

本文著重探討 HDIO OBUFT 和 IOBUF 用例。如果含三態(tài)控制 (OBUFT/IOBUF) 的 HDIO 輸出緩沖器的上電電壓為 3.3 V ...

2023-07-12 標(biāo)簽：以太網(wǎng)寄存器緩沖器 1.5k 0

Versal啟動(dòng)文件簡(jiǎn)述

Versal? 是由多個(gè)高度耦合的可配置塊組成的自適應(yīng)計(jì)算加速平臺(tái)?(ACAP)

2023-07-07 標(biāo)簽：NoC Vivado 啟動(dòng)文件 1.8k 0

如何在IPI流程中修改(以太網(wǎng))IP工程(及其所包含的GT模塊)的代碼與屬性

本文介紹如何修改IP例子工程里的IP和GT模塊的源代碼與屬性

2023-07-10 標(biāo)簽：模塊以太網(wǎng)寄存器 2.4k 0

如何開(kāi)啟Versal的XilSEM功能

本文介紹了如何開(kāi)啟Versal最基本的XilSEM功能。

2023-07-07 標(biāo)簽：寄存器開(kāi)發(fā)板 Versal 894 0

使用QEMU啟動(dòng)Versal VCK190 ACAP

本文涵蓋了有關(guān)使用 PetaLinux 命令行來(lái)對(duì) Versal? ACAP 的 PetaLinux BSP 運(yùn)行 QEMU 的信息

2023-07-07 標(biāo)簽：仿真器開(kāi)源 qemu 1k 0

Versal:JTAG TDO

本文則著重探討 JTAG TDO 用例

2023-07-07 標(biāo)簽：寄存器 JTAG 指令 1k 0

Versal Advanced IO Wizard-部分配置存在時(shí)序收斂問(wèn)題

在Versal Advanced IO Wizard中，所包含的PLL的去歪斜電路可能導(dǎo)致數(shù)據(jù)速率較高時(shí)出現(xiàn)建立時(shí)間

2023-07-07 標(biāo)簽：接口 pll 時(shí)序 859 0

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邏輯芯片又叫可編程邏輯器件，英文全稱為：programmable logic device 即 PLD。PLD是做為一種通用集成電路產(chǎn)生的，他的邏輯功能按照用戶對(duì)器件編程來(lái)確定。一般的PLD的集成度很高，足以滿足設(shè)計(jì)一般的數(shù)字系統(tǒng)的需要。
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