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Versal 產(chǎn)品組合基于 臺積電(TSMC)的 7 nm FinFET 工藝技術(shù),是第一個將軟件可編程性與特定領(lǐng)域硬件加速和靈活應(yīng)變能力相結(jié)合的平臺,這對于跟上當(dāng)今快速的創(chuàng)新步伐至關(guān)重要。
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如何利用XPIO構(gòu)建并實現(xiàn)帶有Strobe的高速接口設(shè)計
在 AMD Versal 自適應(yīng) SoC 器件中,SelectIO 是實現(xiàn)高速接口的重要組成部分。它為器件提供了靈活且高性能的通用 I/O 資源,支持多...
AMD Versal自適應(yīng)SoC內(nèi)置自校準的工作原理
本文提供有關(guān) AMD Versal 自適應(yīng) SoC 內(nèi)置自校準 (BISC) 工作方式的詳細信息。此外還詳述了 Versal 的異步模式及其對 BISC...
AMD Versal自適應(yīng)SoC上的級聯(lián)模式示例
本篇博文主要講解在 PL 中如何使用 AXI Interrupt Controller (INTC) 的級聯(lián)模式,將 IP 核超過 32 個的中斷連接到...
Versal 600G DCMAC Subsystem LogiCORE IP產(chǎn)品指南
AMD 自適應(yīng)計算文檔按一組標準設(shè)計進程進行組織,以便幫助您查找當(dāng)前開發(fā)任務(wù)相關(guān)的內(nèi)容。您可以在設(shè)計中心頁面上訪問 AMD Versal 自適應(yīng) SoC...
AMD Versal自適應(yīng)SoC器件Advanced Flow概覽(下)
在 AMD Vivado Design Suite 2024.2 版本中,Advanced Flow 自動為所有 AMD Versal 自適應(yīng) SoC ...
AMD Versal自適應(yīng)SoC器件Advanced Flow概覽(上)
在最新發(fā)布的 AMD Vivado Design Suite 2024.2 中,引入的新特性之一是啟用了僅適用于 AMD Versal 自適應(yīng) SoC ...
AMD Versal自適應(yīng)SoC DDRMC如何使用Micron仿真模型進行仿真
AMD Versal 自適應(yīng) SoC 器件上 DDR4 硬核控制器 DDRMC 跑仿真時,按照 IP 的默認設(shè)置,在 IP wizard 中使能了“In...
AMD 通過第二代 Versal 器件為 AI 驅(qū)動型嵌入式系統(tǒng)提供單芯片智能
隨著嵌入式 AI、視頻和控制應(yīng)用的爆炸式增長,對異構(gòu)處理的需求越來越大,以便在狹小的區(qū)域和功率限制內(nèi)加速端到端計算。多芯片處理解決方案具有巨大的功耗、面...
2024-11-29 標簽:amd嵌入式系統(tǒng)單芯片 1.4k 0
AMD Versal自適應(yīng)SoC GTM如何用XSIM仿真和觀察PAM4信號
PAM4(4-Level Pulse Amplitude Modulation) 的全稱是四電平脈沖幅度調(diào)制,通過種不同的電平進行信號傳輸,每個電平幅度...
【ALINX 技術(shù)分享】AMD Versal AI Edge 自適應(yīng)計算加速平臺之 Versal 介紹(2)
【ALINX 技術(shù)分享】AMD Versal AI Edge 自適應(yīng)計算加速平臺之 Versal 介紹,以及Versal 芯片開發(fā)流程的簡介。
Versal GTM如何用Tcl命令在IBERT生成QPRBS13序列
目前對于 Vivado 2023.1 版本的 IBERT GUI 界面暫時不支持 QPRBS13 的設(shè)置,需要通過 tcl 或者端口設(shè)置的方法來實現(xiàn)。
AMD Versal系列FPGA NoC介紹及實戰(zhàn)
NoC是相對于SoC的新一代片上互連技術(shù),從計算機發(fā)展的歷史可以看到NoC 必將是SoC 之后的下一代主流技術(shù),SoC 通常指在單一芯片上實現(xiàn)的數(shù)字計算...
Versal HDIO OBUFT和IOBUF三態(tài)時序影響
本文著重探討 HDIO OBUFT 和 IOBUF 用例。如果含三態(tài)控制 (OBUFT/IOBUF) 的 HDIO 輸出緩沖器的上電電壓為 3.3 V ...
本文涵蓋了有關(guān)使用 PetaLinux 命令行來對 Versal? ACAP 的 PetaLinux BSP 運行 QEMU 的信息
Versal Advanced IO Wizard-部分配置存在時序收斂問題
在Versal Advanced IO Wizard中,所包含的PLL的去歪斜電路可能導(dǎo)致數(shù)據(jù)速率較高時出現(xiàn)建立時間
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