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異步復位同步釋放有多個時鐘域時如何處理異步復位同步釋放的策略

對于從FPGA外部進來的信號，我們通常采用“異步復位同步釋放的策略”，具體電路如下圖所示。

2023-07-20 標簽：fpga pll 時鐘 2.6k 0

時鐘樹：芯片的大動脈

我覺得稱時鐘樹為芯片的大動脈一點也不夸張，因為所有flipflop 翻轉都要受到它的控制。而時鐘樹的設計到實現是一個很復雜的過程，從流程上說，它牽扯到使...

2023-07-15 標簽：芯片 pll 時序分析 7k 0

鎖相環(huán)(PLL)電路的組成和參數

鎖相環(huán) （PLL）是電子系統中最通用、最靈活和最有價值的電路配置之一，因此在許多應用中都有使用。它用于時鐘重定時和恢復，作為頻率合成器和可調諧振蕩器，...

2023-07-10 標簽：鎖相環(huán)振蕩器 pll 6.7k 0

JESD204B鏈路中斷時的基本調試技巧

本文旨在提供發(fā)生 JESD204B 鏈路中斷情況下的調試技巧簡介

2023-07-10 標簽：仿真 pll 時鐘 3k 0

Versal Advanced IO Wizard-部分配置存在時序收斂問題

在Versal Advanced IO Wizard中，所包含的PLL的去歪斜電路可能導致數據速率較高時出現建立時間

2023-07-07 標簽：接口 pll 時序 858 0

如何建立一個簡單的PLL電路

本實驗活動介紹鎖相環(huán)(PLL)。PLL電路有一些重要的應用，例如信號調制/解調（主要是頻率和相位調制）、同步、時鐘和數據恢復，以及倍頻和頻率合成。在這項...

2023-07-10 標簽：adi 鎖相環(huán)pll 1.8k 0

BK3432 BLE時鐘與供電方式配置

本文講解基于BK3432_SDK，配置主頻時鐘與供電方式。

2023-07-02 標簽：ldo 晶振 pll 2.4k 0

數字頻率合成器的作用

數字頻率合成器（Digital Frequency Synthesizer）是一種電子設備，用于生成精確的、可編程的高穩(wěn)定度的頻率信號。它的主要作用是在...

2023-06-30 標簽：合成器 pll 數字頻率 1.5k 0

晶振輸出頻率偏差過大，會怎么樣？

晶振常用標稱頻率在1~200MHz之間。如果需要更高更穩(wěn)定的輸出頻率，可以使用鎖相環(huán)PLL將低頻晶振進行倍頻到1GHz以上的標稱頻率。鎖相環(huán)PLL電路由...

2023-06-21 標簽：振蕩器晶振 pll 2.3k 0

應用工程師咨詢：寬帶CMOS開關

CMOS 寬帶交換機主要設計用于滿足以 ISM（工業(yè)、科學和醫(yī)療）頻段頻率（900 MHz 及以上）傳輸的設備的要求。這些器件具有低插入損耗、端口間高隔...

2023-06-17 標簽：CMOS pll 交換機 1.6k 0

咨詢應用工程師：關于直接數字合成的一切

直接數字頻率合成（DDS）是一種通過生成數字形式的時變信號，然后執(zhí)行數模轉換來產生模擬波形（通常是正弦波）的方法。由于DDS設備內的操作主要是數字操...

2023-06-17 標簽：DAC pll DDS 2.9k 0

咨詢應用工程師：PLL頻率合成器

頻率合成器在鎖相環(huán) （PLL）中工作，其中相位/頻率檢測器（PFD）將反饋頻率與參考頻率的分頻版本進行比較（圖 1）。PFD的輸出電流脈沖經過濾波...

2023-06-17 標簽：pll VCO PFD 2k 0

用于高頻接收器和發(fā)射器的鎖相環(huán)—第三部分

本系列第一部分介紹了鎖相環(huán)(PLL)，說明了其基本架構和工作原理。另外舉例說明了PLL在通信系統中的用途。在第二部分中，我們詳細考察了相位噪聲、參...

2023-06-17 標簽：通信系統 pll VCO 2k 0

用于高頻接收器和發(fā)射器的鎖相環(huán)—第二部分

在第二部分中，我們將側重于詳細考察與PLL相關的兩個關鍵技術規(guī)格：相位噪聲和參考雜散。導致相位噪聲和參考雜散的原因是什么，如何將其影響降至最低？討論...

2023-06-17 標簽：接收器 pll VCO 1.9k 0

用于高頻接收器和發(fā)射器的鎖相環(huán)—第一部分

第一部分將重點介紹有關PLL的基本概念，同時描述基本PLL 架構和工作原理，另外，我們還將舉例說明PLL在通信系統中的用途。最后，我們將展示一種運用A...

2023-06-17 標簽：振蕩器接收器 pll 1.7k 0

提供顯著跳頻(FH)優(yōu)勢的下一代軟件定義無線電(SDR)收發(fā)器

本文深入探討了跳頻(FH)的概念，以及如何通過靈活設計 ADRV9002?SDR 收發(fā)器的鎖相環(huán)(PLL)架構來實現四大跳頻特性。這些特性可為用戶提供強...

2023-06-15 標簽：收發(fā)器 pll DPD 2.5k 0

在16通道演示器中驗證的經驗型多通道相位噪聲模型

相位噪聲是衡量所有RF系統設計的一個重要的性能指標。在相控陣這類大型多通道RF系統中，通道之間彼此關聯，其目標之一就是利用分布式接收器和發(fā)射器的關聯組合...

2023-06-15 標簽：振蕩器 pll RF 873 0

使用具有射頻鎖相環(huán)相位同步特性的SDR簡化天線校準

本文著重介紹ADI公司的軟件定義無線電(SDR)中的射頻(RF)鎖相環(huán)(PLL)相位同步特性。這個功能有助于降低天線校準的復雜性，特別是對于采用大型天線...

2023-06-14 標簽：射頻 pll 無線電 2.4k 0

位到波束：5G毫米波無線電射頻技術演進

本文分為三大主題。在第一部分，我們將討論毫米波通信的一些主要用例，為接下來的分析做鋪墊。在第二和第三部分，我們將深入研究毫米波基站系統的架構和技術。在第...

2023-06-14 標簽：pll 無線電毫米波 1.5k 0

XILINX FPGA IP之MMCM PLL DRP時鐘動態(tài)重配詳解

上文XILINX FPGA IP之Clocking Wizard詳解說到時鐘IP的支持動態(tài)重配的，本節(jié)介紹通過DRP進行MMCM PLL的重新配置。

2023-06-12 標簽：fpga 寄存器 Xilinx 1.6萬 0

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