asic

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ASIC是Application Specific Integrated Circuit的英文縮寫(xiě)，在集成電路界被認(rèn)為是一種為專(zhuān)門(mén)目的而設(shè)計(jì)的集成電路。ASIC也是Australian Securities and Investment Commission的英文縮寫(xiě)，即澳大利亞證券和投資委員會(huì)，它是澳大利亞金融服務(wù)和市場(chǎng)的法定監(jiān)管機(jī)構(gòu)。

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asic技術(shù)

AMD-Xilinx在20nm & 16nm節(jié)點(diǎn)Ultrascale系列器件使用FinFET工藝，F(xiàn)inFET與Planar相比在相同速度條件下...

2022-12-29 標(biāo)簽：FPGA設(shè)計(jì)asic 晶體管 2.2k 0

關(guān)于IBM的專(zhuān)用集成電路設(shè)計(jì)流程以及RLM設(shè)計(jì)流程的優(yōu)點(diǎn)詳解

隨著集成電路工藝技術(shù)的不斷發(fā)展，集成電路的特征設(shè)計(jì)尺寸進(jìn)入到深亞微米，芯片規(guī)模擴(kuò)大到百萬(wàn)門(mén)級(jí)，從計(jì)算量、后端布局布線（placement&routin...

2018-08-06 標(biāo)簽：集成電路 IBM ASIC 2.2k 0

FPGA與ASIC的優(yōu)缺點(diǎn)比較

FPGA（現(xiàn)場(chǎng)可編程門(mén)陣列）與ASIC（專(zhuān)用集成電路）是兩種不同的硬件實(shí)現(xiàn)方式，各自具有獨(dú)特的優(yōu)缺點(diǎn)。以下是對(duì)兩者優(yōu)缺點(diǎn)的比較： FPGA的優(yōu)點(diǎn) 可編程...

2024-10-25 標(biāo)簽：FPGA 集成電路 asic 2.2k 0

時(shí)序邏輯：FPGA/ASIC電路結(jié)構(gòu)

FPGA采用了邏輯單元陣列LCA（Logic Cell Array）這樣一個(gè)概念，內(nèi)部包括可配置邏輯模塊CLB（Configurable Logic B...

2019-12-02 標(biāo)簽：fpga asic 時(shí)序 2.2k 0

智能處理器選擇之8051微控制器技術(shù)應(yīng)用

最初的 Intel 8051 以每個(gè)機(jī)器周期 12 個(gè)時(shí)鐘周期運(yùn)行，大多數(shù)指令在一個(gè)到兩個(gè)機(jī)器周期內(nèi)執(zhí)行。典型的最大時(shí)鐘頻率為12MHz，這意味著這些老...

2023-08-02 標(biāo)簽：微控制器單片機(jī)arm 2.1k 0

FPGA工作原理與簡(jiǎn)介

如前所述，F(xiàn)PGA是在PAL、GAL、EPLD、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為ASIC領(lǐng)域中的一種半定制電路而出現(xiàn)的，即解決了定...

2022-11-28 標(biāo)簽：fpga asic LUT 2.1k 0

ASIC芯片設(shè)計(jì)之UVM驗(yàn)證

百度百科對(duì)UVM的釋義如下：通用驗(yàn)證方法學(xué)（Universal Verification Methodology, UVM）是一個(gè)以SystemVeri...

2022-11-30 標(biāo)簽：asic UVM 2.1k 0

剖析FPGA的應(yīng)用場(chǎng)景

那FPGA有啥優(yōu)勢(shì)呢，這也要對(duì)比ASIC來(lái)說(shuō)，因?yàn)锳SIC芯片只是針對(duì)某一項(xiàng)功能做的專(zhuān)用芯片，如果要完成其他的功能就還得做一個(gè)另外的專(zhuān)用ASIC芯片，這...

2023-03-21 標(biāo)簽：fpga 芯片 asic 2.1k 0

動(dòng)態(tài)可重構(gòu)系統(tǒng)的通信結(jié)構(gòu)在交通燈中的應(yīng)用及發(fā)展分析

基于SRAM的FPGA的問(wèn)世標(biāo)志著現(xiàn)代可重構(gòu)計(jì)算技術(shù)的開(kāi)端，并極大地推動(dòng)了其發(fā)展。可重構(gòu)計(jì)算技術(shù)能夠提供硬件的效率和軟件的可編程性，它綜合了微處理器和A...

2019-04-18 標(biāo)簽：fpga asic 微處理器 2.1k 0

如何采用IXP1200網(wǎng)絡(luò)處理器構(gòu)建路由器

網(wǎng)絡(luò)處理器是現(xiàn)代綜合業(yè)務(wù)數(shù)據(jù)網(wǎng)絡(luò)不斷發(fā)展更新的產(chǎn)物,是一種基于可編程 ASIC 結(jié) 構(gòu)的新一代SoC 芯片。它是為了適應(yīng)下一代高速網(wǎng)絡(luò)特點(diǎn)，即為了能夠提...

2019-01-15 標(biāo)簽：處理器 asic 路由器 2.1k 0

FPGA入門(mén)之什么是FPGA

FPGA 的全稱(chēng)為 Field-Programmable Gate Array ，即現(xiàn)場(chǎng)可編程門(mén)陣列。FPGA 是在 PAL、 GAL、 CPLD 等可...

2023-03-21 標(biāo)簽：fpga 集成電路 asic 2.1k 0

Xilinx新一代UltraScale架構(gòu)成為ASIC或SOC原型驗(yàn)證的極佳選擇

近年來(lái)，ASIC設(shè)計(jì)規(guī)模的增大帶來(lái)了前所未有的芯片原型驗(yàn)證問(wèn)題，單顆大容量的FPGA通常已不足以容下千萬(wàn)門(mén)級(jí)、甚至上億門(mén)級(jí)的邏輯設(shè)計(jì)?，F(xiàn)今，將整個(gè)驗(yàn)證設(shè)...

2018-07-02 標(biāo)簽：asic soc xilinx 2.1k 0

變速驅(qū)動(dòng)器中使用的集成電路的功能安全

IEC 61508-2：2010包含重要的IC要求，但在偶然或不完整的標(biāo)準(zhǔn)閱讀中很容易錯(cuò)過(guò)。要求包括ASIC開(kāi)發(fā)V模型，參見(jiàn)IEC 61508-2：20...

2023-01-06 標(biāo)簽：集成電路驅(qū)動(dòng)器 asic 2.1k 0

基于Xilinx FPGA用于ASIC前端驗(yàn)證的問(wèn)題總結(jié)

FPGA本身是有專(zhuān)門(mén)的時(shí)鐘cell的，以xilinx FPGA為例，就是primitive庫(kù)中的BUFG。

2018-12-22 標(biāo)簽：fpga asic xilinx 2.1k 0

在NVIDIA Spectrum交換機(jī)上使用精確定時(shí)協(xié)議計(jì)算和同步時(shí)間

PTP 使用一種算法和方法在基于數(shù)據(jù)包的網(wǎng)絡(luò)上同步各種設(shè)備上的時(shí)鐘，以提供亞微秒精度。 NVIDIA Spectrum 支持一步和兩步模式的 PTP ，...

2022-10-11 標(biāo)簽：以太網(wǎng)asic 交換機(jī) 2.1k 0

嵌入式存儲(chǔ)器的主要設(shè)計(jì)標(biāo)準(zhǔn)分析及IP選用指南

在傳統(tǒng)的大規(guī)模ASIC和SoC設(shè)計(jì)中，芯片的物理空間大致可分為用于新的定制邏輯、用于可復(fù)用邏輯(第三方IP或傳統(tǒng)的內(nèi)部IP)和用于嵌入式存儲(chǔ)三部分。當(dāng)...

2018-02-02 標(biāo)簽：嵌入式 asic 存儲(chǔ)器 2.1k 0

什么是FPGA原型驗(yàn)證？FPGA原型設(shè)計(jì)的好處是什么？

FPGA原型設(shè)計(jì)是一種成熟的技術(shù)，用于通過(guò)將RTL移植到現(xiàn)場(chǎng)可編程門(mén)陣列（FPGA）來(lái)驗(yàn)證專(zhuān)門(mén)應(yīng)用的集成電路（ASIC），專(zhuān)用標(biāo)準(zhǔn)產(chǎn)品（ASSP）和片上...

2024-01-12 標(biāo)簽：處理器 fpga 集成電路 2.1k 0

評(píng)估低抖動(dòng)PLL時(shí)鐘發(fā)生器的電源噪聲抑制

采用PLL的時(shí)鐘發(fā)生器廣泛用于網(wǎng)絡(luò)設(shè)備中，用于生成高精度和低抖動(dòng)參考時(shí)鐘或保持同步網(wǎng)絡(luò)操作。大多數(shù)時(shí)鐘振蕩器使用理想、干凈的電源給出其抖動(dòng)或相位噪聲規(guī)格...

2023-03-08 標(biāo)簽：電源 asic pll 2.1k 0

安森美半導(dǎo)體配合中國(guó)消費(fèi)類(lèi)醫(yī)療市場(chǎng)趨勢(shì)的半導(dǎo)體方案應(yīng)用案例研究

安森美半導(dǎo)體為中國(guó)消費(fèi)類(lèi)醫(yī)療設(shè)備市場(chǎng)提供多種價(jià)值，包括涵蓋助聽(tīng)器數(shù)字信號(hào)處理器（DSP）系統(tǒng)、定制混合信號(hào)專(zhuān)用集成電路（ASIC）、分立元件以及有助于實(shí)...

2013-08-20 標(biāo)簽：DSP ASIC 助聽(tīng)器 2.1k 0

FPGA技術(shù)的五大優(yōu)勢(shì)

各行各業(yè)紛紛采用FPGA芯片是源于FPGA融合了ASIC和基于處理器的系統(tǒng)的最大優(yōu)勢(shì)。 FPGA能夠提供硬件定時(shí)的速度和穩(wěn)定性，且無(wú)需類(lèi)似自定制ASIC...

2024-04-23 標(biāo)簽：FPGA 集成電路 asic 2k 0

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Protues

Protues

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Proteus軟件是英國(guó)Lab Center Electronics公司出版的EDA工具軟件（該軟件中國(guó)總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

靜電防護(hù)

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
Altium Designer

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FPGA芯片

FPGA芯片

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FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門(mén)陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
ArduBlock

ArduBlock

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ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會(huì)使編程的可視化和交互性加強(qiáng)，編程門(mén)檻降低，即使沒(méi)有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫(xiě)程序。
AD10

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FPGA開(kāi)發(fā)板

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FPGA開(kāi)發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來(lái)實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車(chē)工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過(guò)去汽車(chē)電子產(chǎn)品的開(kāi)發(fā)周期是漫長(zhǎng)的，而許多汽車(chē)制造商現(xiàn)正致力于在更短的時(shí)間內(nèi)，裝備消費(fèi)者所需的新一代汽車(chē)。
PCB封裝

PCB封裝

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pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長(zhǎng)寬，直插，貼片，焊盤(pán)的大小，管腳的長(zhǎng)寬，管腳的間距等）用圖形方式表現(xiàn)出來(lái)，以便可以在畫(huà)pcb圖時(shí)進(jìn)行調(diào)用。
QUARTUS II

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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開(kāi)發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
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PCB封裝庫(kù)

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QuickPcb

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Artix-7

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　　Artix-7 系列：相對(duì)于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿足低成本大批量市場(chǎng)的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對(duì)的市場(chǎng)領(lǐng)域。
VHDL代碼

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Protel 99 se

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面包板

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面包板是由于板子上有很多小插孔，專(zhuān)為電子電路的無(wú)焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
candence

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AXI

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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對(duì)齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫(xiě)數(shù)據(jù)通道、并支持Outstanding傳輸訪問(wèn)和亂序訪問(wèn)，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
特性阻抗

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特性阻抗又稱(chēng)特征阻抗，它不是直流電阻，屬于長(zhǎng)線傳輸中的概念。特性阻抗是射頻傳輸線影響無(wú)線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱(chēng)阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
時(shí)鐘源

時(shí)鐘源

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時(shí)鐘源用來(lái)為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號(hào)。它通常由石英晶體振蕩器和與非門(mén)組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
AD采樣

AD采樣

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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號(hào)，也可以是壓力、溫度、濕度、位移、聲音等非電信號(hào)；而AD分辨率指數(shù)字量變化一個(gè)最小量時(shí)模擬信號(hào)的變化量。
驅(qū)動(dòng)電流

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Kintex-7

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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性價(jià)比提高了一倍，功耗降低了一半。
Protel DXP

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