asic

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ASIC是Application Specific Integrated Circuit的英文縮寫，在集成電路界被認(rèn)為是一種為專門目的而設(shè)計(jì)的集成電路。ASIC也是Australian Securities and Investment Commission的英文縮寫，即澳大利亞證券和投資委員會(huì)，它是澳大利亞金融服務(wù)和市場(chǎng)的法定監(jiān)管機(jī)構(gòu)。

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asic技術(shù)

計(jì)算架構(gòu)：從異構(gòu)到超異構(gòu)技術(shù)解讀

ISA（Instruction Set Architecture，指令集架構(gòu)），是計(jì)算機(jī)體系結(jié)構(gòu)與編程相關(guān)的部分（不包含組成和實(shí)現(xiàn)）。ISA定義了：指令...

2023-01-01 標(biāo)簽：asic cpu 4.6k 0

FPGA芯片結(jié)構(gòu)介紹及工作原理解析

由于FPGA需要被反復(fù)燒寫，它實(shí)現(xiàn)組合邏輯的基本結(jié)構(gòu)不可能像ASIC那樣通過固定的與非門來完成，而只能采用一種易于反復(fù)配置的結(jié)構(gòu)。

2022-12-27 標(biāo)簽：fpga asic sram 1.5k 0

功能豐富的系統(tǒng)需要靈活且可配置的20V大電流PMIC

技術(shù)的不斷進(jìn)步增加了所有電子系統(tǒng)的功能內(nèi)容，同時(shí)減少了可用空間。手機(jī)有觸摸屏、手電筒、省電模式和復(fù)雜的相機(jī)。

2022-12-21 標(biāo)簽：驅(qū)動(dòng)器 asic PLD 1.8k 0

為什么IBIS建模對(duì)設(shè)計(jì)成功至關(guān)重要

IBIS 代表輸入/輸出緩沖器信息規(guī)范。它表示IC供應(yīng)商提供給其客戶以用于高速設(shè)計(jì)仿真的器件數(shù)字引腳的特性或行為。這些模型使用IBIS開放論壇指定的參...

2022-12-15 標(biāo)簽：asic 緩沖器晶體管 1.8k 0

幾種FPGA原理設(shè)計(jì)圖的性能與應(yīng)用分析

時(shí)至今日，F(xiàn)PGA市場(chǎng)的主要業(yè)者僅剩數(shù)家，包括Altera、Xilinx（賽靈思，過去稱為：智霖科技）、Actel、Atmel、Lattice、Quic...

2022-12-09 標(biāo)簽：fpga 單片機(jī)cpld 3.5k 0

ASIC芯片設(shè)計(jì)之UVM驗(yàn)證

百度百科對(duì)UVM的釋義如下：通用驗(yàn)證方法學(xué)（Universal Verification Methodology, UVM）是一個(gè)以SystemVeri...

2022-11-30 標(biāo)簽：asic UVM 2.1k 0

FPGA工作原理與簡(jiǎn)介

如前所述，F(xiàn)PGA是在PAL、GAL、EPLD、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為ASIC領(lǐng)域中的一種半定制電路而出現(xiàn)的，即解決了定...

2022-11-28 標(biāo)簽：fpga asic LUT 2.1k 0

突破性、可擴(kuò)展、直觀的電源排序系統(tǒng)可加快設(shè)計(jì)和調(diào)試

眾所周知，電子系統(tǒng)在所有行業(yè)中都變得越來越復(fù)雜。這種復(fù)雜性如何滲透到電源設(shè)計(jì)中并不那么明顯。例如，功能復(fù)雜性通常通過使用 ASIC、FPGA 和微處理器...

2022-11-23 標(biāo)簽：fpga asic 微處理器 951 0

通過縮短測(cè)試時(shí)間減少ASIC設(shè)計(jì)中的DFT占位面積

ASIC，如名稱所定義，是為特定應(yīng)用而設(shè)計(jì)的。可以使用不同的技術(shù)來創(chuàng)建ASIC，但由于高可靠性和低成本，CMOS很常見。對(duì)于ASIC（SoC設(shè)計(jì)），功耗...

2022-11-23 標(biāo)簽：傳感器 asic soc 1.8k 0

詳細(xì)分析DPU認(rèn)識(shí)的四個(gè)層級(jí)

云計(jì)算是由IaaS、PaaS以及SaaS組成的分層服務(wù)體系，計(jì)算、存儲(chǔ)和網(wǎng)絡(luò)是IaaS層核心的三類服務(wù)。

2022-11-21 標(biāo)簽：asic DPU DSA 2.3k 0

FPGA邏輯設(shè)計(jì)與驗(yàn)證流程

靜態(tài)時(shí)序分析是一種重要的邏輯驗(yàn)證方法，設(shè)計(jì)者根據(jù)靜態(tài)時(shí)序分析的結(jié)果來修改和優(yōu)化邏輯，直到設(shè)計(jì)滿足要求。

2022-11-11 標(biāo)簽：fpga asic 914 0

FPGA芯片中邏輯資源和門是如何對(duì)應(yīng)的

而且現(xiàn)在的LUT都是4輸入或者6輸入，可以做成邏輯門的組合，跟普通的邏輯門個(gè)數(shù)肯定不會(huì)是一對(duì)一關(guān)系。今天我們來看下這個(gè)關(guān)系如果對(duì)應(yīng)。

2022-11-11 標(biāo)簽：asic LUT FPGA芯片 3.4k 0

RTL建模中的函數(shù)和任務(wù)討論

函數(shù)和任務(wù)可以在使用它們的模塊或接口中定義。定義可以出現(xiàn)在調(diào)用函數(shù)或任務(wù)的語句之前或之后完成，函數(shù)和任務(wù)也可以在包中定義，然后導(dǎo)入到模塊或接口中，包導(dǎo)入...

2022-11-09 標(biāo)簽：fpga asic RTL 1.7k 0

FPGA中邏輯資源和門是如何進(jìn)行對(duì)應(yīng)的

2022-11-01 標(biāo)簽：fpga asic LUT 1.5k 0

HLSR系列電流傳感器的開發(fā)方案

到目前為止，集成電流傳感器（ICS）的發(fā)展是緩慢而漸進(jìn)的。多年來，目前的測(cè)量技術(shù)越來越受到發(fā)展，專注于高密度組件的小型化，這些組件也可以提供高水平的性能...

2022-10-20 標(biāo)簽：asic 霍爾效應(yīng)電流傳感器 2.3k 0

機(jī)器視覺檢測(cè)中如何提高檢測(cè)圖像處理速度

機(jī)器視覺（Machine Vision）是人工智能領(lǐng)域中發(fā)展迅速的一個(gè)重要分支，目前正處于不斷突破、走向成熟的階段。 ? 一般認(rèn)為機(jī)器視覺是通過光學(xué)裝置...

2022-10-18 標(biāo)簽：asic 圖像處理機(jī)器視覺 2.4k 0

ASIC單個(gè)模塊的設(shè)計(jì)和優(yōu)化思路

ASIC設(shè)計(jì)中詳細(xì)設(shè)計(jì)方案的確定非常重要，同樣的設(shè)計(jì)，別人可以用比你小30%的面積和少30%的處理時(shí)間來實(shí)現(xiàn)，這才是設(shè)計(jì)工程師的價(jià)值體現(xiàn)之處。任何設(shè)計(jì)在...

2022-10-12 標(biāo)簽：asic 寄存器 1.3k 0

基于ASIC單個(gè)模塊的設(shè)計(jì)/優(yōu)化思路

ASIC設(shè)計(jì)中詳細(xì)設(shè)計(jì)方案的確定非常重要，同樣的設(shè)計(jì)，別人可以用比你小30%的面積和少30%的處理時(shí)間來實(shí)現(xiàn)，這才是設(shè)計(jì)工程師的價(jià)值體現(xiàn)之處。

2022-10-12 標(biāo)簽：芯片 asic 寄存器 730 0

在NVIDIA Spectrum交換機(jī)上使用精確定時(shí)協(xié)議計(jì)算和同步時(shí)間

PTP 使用一種算法和方法在基于數(shù)據(jù)包的網(wǎng)絡(luò)上同步各種設(shè)備上的時(shí)鐘，以提供亞微秒精度。 NVIDIA Spectrum 支持一步和兩步模式的 PTP ，...

2022-10-11 標(biāo)簽：以太網(wǎng)asic 交換機(jī) 2.1k 0

基于使用FPGA實(shí)現(xiàn)低延遲的成像系統(tǒng)

上面的架構(gòu)是比較通用的架構(gòu)，官方也有例程可以參考，但是上面架構(gòu)多了一個(gè)VDMA，這就導(dǎo)致視頻傳輸?shù)臅r(shí)候有1到幾幀的延遲，這對(duì)于低延遲、高分辨率的情形肯定...

2022-10-08 標(biāo)簽：fpga asic 成像系統(tǒng) 3.8k 0

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Protues

Protues

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Proteus軟件是英國(guó)Lab Center Electronics公司出版的EDA工具軟件（該軟件中國(guó)總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

靜電防護(hù)

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
Altium Designer

Altium Designer

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FPGA芯片

FPGA芯片

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FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
ArduBlock

ArduBlock

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ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會(huì)使編程的可視化和交互性加強(qiáng)，編程門檻降低，即使沒有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫程序。
AD10

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識(shí)別

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FPGA開發(fā)板

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FPGA開發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過去汽車電子產(chǎn)品的開發(fā)周期是漫長(zhǎng)的，而許多汽車制造商現(xiàn)正致力于在更短的時(shí)間內(nèi)，裝備消費(fèi)者所需的新一代汽車。
PCB封裝

PCB封裝

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pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長(zhǎng)寬，直插，貼片，焊盤的大小，管腳的長(zhǎng)寬，管腳的間距等）用圖形方式表現(xiàn)出來，以便可以在畫pcb圖時(shí)進(jìn)行調(diào)用。
QUARTUS II

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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
語音交互

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PCB封裝庫

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PDN

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QuickPcb

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Artix-7

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　　Artix-7 系列：相對(duì)于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿足低成本大批量市場(chǎng)的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對(duì)的市場(chǎng)領(lǐng)域。
VHDL代碼

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powerlink

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Protel 99 se

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面包板

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面包板是由于板子上有很多小插孔，專為電子電路的無焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
candence

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AXI

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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對(duì)齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫數(shù)據(jù)通道、并支持Outstanding傳輸訪問和亂序訪問，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
特性阻抗

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特性阻抗又稱特征阻抗，它不是直流電阻，屬于長(zhǎng)線傳輸中的概念。特性阻抗是射頻傳輸線影響無線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
時(shí)鐘源

時(shí)鐘源

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時(shí)鐘源用來為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號(hào)。它通常由石英晶體振蕩器和與非門組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
AD采樣

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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號(hào)，也可以是壓力、溫度、濕度、位移、聲音等非電信號(hào)；而AD分辨率指數(shù)字量變化一個(gè)最小量時(shí)模擬信號(hào)的變化量。
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Kintex-7

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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性價(jià)比提高了一倍，功耗降低了一半。
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